Ingénieur compilation RISC-V - Toolchain reconfigurable pour SoC
Rendez une toolchain GCC/LLVM indépendante du matériel et menez son passage du VLIW au RISC-V, chez un acteur européen de l'accélération matérielle.
L'entreprise
/!\ Disclaimer : Nous ne sommes pas une SSII/ESN, et ce poste n'est pas à pourvoir dans une SSII/ESN mais bien dans un bureau d'étude, en CDI direct. A bon entendeur ;)
Une entreprise européenne de l'accélération matérielle, qui maîtrise toute la chaîne en interne : IP, SoC, cartes, firmware, logiciel et outils de développement, jusqu'à sa propre toolchain et ses simulateurs.
Ses processeurs et ses IP équipent des systèmes qui traitent de gros volumes de données : datacenter, networking, stockage, calcul et IA. Le traitement de flux Ethernet et PCIe à très haut débit est au cœur de son offre.
L'entreprise se positionne aujourd'hui comme fournisseur d'IP networking et fait évoluer ses processeurs vers un modèle compatible RISC-V, en conservant le savoir-faire de son cœur. Ses IP s'intègrent dans des SoC aux configurations différentes, et les outils de développement doivent suivre chacune d'elles.
D'où ce recrutement : faire de la toolchain une brique générique, capable de s'adapter à chaque configuration matérielle.
Les équipes sont décloisonnées. Un ingénieur toolchain échange directement avec les architectes, les designers hardware ou l'équipe firmware, sans passer par trois niveaux d'intermédiaires.
La transition vers RISC-V démarre, et c'est maintenant que se décide l'architecture de la toolchain qui l'accompagnera.
Le poste
Vous rejoignez l'équipe Toolchain, qui construit et maintient l'écosystème de développement des processeurs de l'entreprise : compilateurs, runtimes, bibliothèques, débogueurs, SDK, outils de build et de profiling.
Cet écosystème repose sur les briques open source de référence (GCC, LLVM, binutils, GDB, CMake), adaptées aux architectures maison. Il évolue aujourd'hui dans deux directions : le passage au jeu d'instructions RISC-V, et le découplage entre la toolchain et le matériel qu'elle cible.
1 - Une couche d'abstraction entre toolchain et matériel
L'objectif est une toolchain indépendante du hardware : générique, et reconfigurable selon la configuration du SoC visé. Vous concevez et développez la couche d'abstraction qui le permet, en définissant ce qui relève du socle commun et ce qui dépend de la cible. Une évolution de l'architecture matérielle doit se traduire par une reconfiguration de la chaîne, pas par un nouveau chantier.
2 - Du VLIW au RISC-V
L'existant s'est construit autour d'une architecture VLIW. Vous menez son transfert vers RISC-V, en identifiant ce qui se reprend, ce qui se réécrit et ce qui s'appuie sur le support RISC-V déjà présent dans GCC et LLVM. L'enjeu : conserver le savoir-faire d'optimisation accumulé sur l'architecture de l'entreprise, tout en s'alignant sur un écosystème standard.
3 - Build, packaging et livraison
Une toolchain reconfigurable doit aussi se construire, se tester et se livrer pour chaque configuration. Vous faites évoluer les flots de build, de packaging, de déploiement et de CI/CD dans de grands environnements Linux, avec une attention forte à l'automatisation des tests, à un moment où la CI de l'entreprise est elle-même repensée.
4 - Un rôle de référent
Vous participez aux discussions d'architecture et pesez sur les décisions liées aux outils de développement et à l'enablement des plateformes. Vous travaillez avec les équipes architecture, firmware, runtime et applicatives pour garder l'ensemble cohérent, vous relisez le code de vos pairs et contribuez aux projets open source quand c'est pertinent.
Ce poste s'adresse à un ingénieur qui aime comprendre comment un jeu d'instructions se traduit en code généré, et qui voit dans une transition d'architecture l'occasion de repenser la structure d'un outil.
Le profil recherché
Vous avez déjà travaillé à l'intérieur d'une toolchain : un backend de compilateur, un assembleur ou un éditeur de liens, un débogueur, des runtimes. Vous connaissez les internes de GCC ou de LLVM et la génération de code, et vous développez en C et C++ dans des environnements Linux au quotidien.
Vos cibles étaient des systèmes embarqués ou des plateformes hétérogènes, en cross-compilation, là où l'architecture du processeur compte. Les flots de CI, de tests automatisés et de release vous parlent, puisque c'est par eux que passe chaque livraison d'une toolchain.
Ce qui fera la différence ici, c'est votre capacité à séparer ce qui est propre à une architecture de ce qui peut devenir générique. Si vous avez déjà ajouté une cible à une toolchain, porté des outils d'une architecture à une autre ou travaillé sur RISC-V, vous retrouverez des situations familières. Le débogage et l'analyse de performance feront partie du quotidien : comprendre pourquoi le code généré ne tient pas ses promesses, ou pourquoi un build passe sur une configuration de SoC et casse sur une autre.
Vos interlocuteurs seront des architectes, des designers hardware, des équipes firmware, runtime et applicatives, dans un contexte international. Il faudra défendre un choix d'architecture d'outil face à des métiers qui n'ont pas les mêmes contraintes, en français comme en anglais.
C'est un CDI direct, pas en presta ;) L'équipe en-core vous accompagne tout au long du process.
À bientôt,
L'équipe en-core
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